Merge branch '2022-12-09-platform-updates' into next

- Assorted TI platform updates
- Add DM_RTC callback functions, and a related x86 clean-up.

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diff --git a/drivers/ram/k3-ddrss/am64/lpddr4_ctl_regs.h b/drivers/ram/k3-ddrss/am64/lpddr4_ctl_regs.h
new file mode 100644
index 00000000000..bd29fad1856
--- /dev/null
+++ b/drivers/ram/k3-ddrss/am64/lpddr4_ctl_regs.h
@@ -0,0 +1,1306 @@
+/* SPDX-License-Identifier: BSD-3-Clause */
+/*
+ * Cadence DDR Driver
+ *
+ * Copyright (C) 2012-2022 Cadence Design Systems, Inc.
+ * Copyright (C) 2018-2022 Texas Instruments Incorporated - https://www.ti.com/
+ */
+
+#ifndef REG_LPDDR4_CTL_REGS_H_
+#define REG_LPDDR4_CTL_REGS_H_
+
+#include "lpddr4_ddr_controller_macros.h"
+#include "lpddr4_pi_macros.h"
+#include "lpddr4_data_slice_0_macros.h"
+#include "lpddr4_data_slice_1_macros.h"
+#include "lpddr4_address_slice_0_macros.h"
+#include "lpddr4_address_slice_1_macros.h"
+#include "lpddr4_address_slice_2_macros.h"
+#include "lpddr4_phy_core_macros.h"
+
+typedef struct __attribute__((packed)) lpddr4_ctlregs_s {
+	volatile u32 DENALI_CTL_0;
+	volatile u32 DENALI_CTL_1;
+	volatile u32 DENALI_CTL_2;
+	volatile u32 DENALI_CTL_3;
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+	volatile u32 DENALI_CTL_26;
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+	volatile u32 DENALI_CTL_127;
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+	volatile u32 DENALI_CTL_129;
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+
+#endif /* REG_LPDDR4_CTL_REGS_H_ */